SISTEMA INHIBIDOR DE ATAQUES HARDWARE EN UN BUS I2C, MODULO ESCLAVO Y RED QUE LO COMPRENDE.

Un sistema inhibidor de ataques hardware para un módulo esclavo (20) en un buses I2C que incluye detector (42) para detectar el inicio de comunicación en la línea de datos SDA y para generar una señal de inicialización;

un oscilador (44) para generar una señal de reloj independiente; un medidor (46) para medir automáticamente la frecuencia de la señal de sincronización SCL y para compararla con la señal de reloj del oscilador (44) y para generar una señal indicando la existencia de ataque; un dispositivo de respuesta (48) configurado para recibir la señal indicando la existencia de ataque y para regenerar la línea SCL a partir de la señal del dispositivo oscilador (44).

Tipo: Patente Internacional (Tratado de Cooperación de Patentes). Resumen de patente/invención. Número de Solicitud: PCT/ES2017/070336.

Solicitante: UNIVERSIDAD DE HUELVA.

Nacionalidad solicitante: España.

Inventor/es: GOMEZ GALAN,JUAN ANTONIO, SÁNCHEZ RAYA,Manuel, GÓMEZ BRAVO,Fernando, JIMÉNEZ NAHARRO,Raúl, MEDINA GARCIA,Jonatan.

Fecha de Publicación: .

Clasificación Internacional de Patentes:

  • G06F13/42 SECCION G — FISICA.G06 COMPUTO; CALCULO; CONTEO.G06F TRATAMIENTO DE DATOS DIGITALES ELECTRICOS (computadores en los que una parte del cálculo se efectúa hidráulica o neumáticamente G06D, ópticamente G06E; sistemas de computadores basados en modelos de cálculo específicos G06N). › G06F 13/00 Interconexión o transferencia de información u otras señales entre memorias, dispositivos de entrada/salida o unidades de tratamiento (circuitos de interfaz para dispositivos de entrada/salida específicos G06F 3/00; sistemas multiprocesadores G06F 15/16). › Protocolo de transferencia para bus, p. ej. interbloqueo; Sincronización.
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