Método y aparato para detectar contrapresión de mensajes.

Un método de detección de contrapresión de paquetes, en donde el método se aplica a un dispositivo que tiene un puerto de Interconexión de Componentes Periféricos Exprés,

PCIe, y el método comprende:

almacenar (601), mediante el dispositivo en una memoria temporal cuando cada paquete a enviar en una cola de envío de paquetes de un puerto PCIe en una unidad de memoria caché se convierte en un paquete que actualmente necesita ser enviado desde el puerto PCIe, el paquete que actualmente necesita ser enviado, en donde el paquete que actualmente necesita ser enviado es el primer paquete en la cola de envío de paquetes, en donde el paquete almacenado en la memoria temporal se retira de la memoria temporal después de ser enviado utilizando el puerto PCIe;

registrar (602), mediante el dispositivo, la duración de almacenamiento de cada paquete almacenado en la memoria temporal, y acumular la duración de almacenamiento registrada de cada paquete en la memoria temporal, con el objetivo de obtener la duración acumulada de almacenamiento de paquetes en la memoria temporal;

reiniciar, mediante el dispositivo, la duración acumulada a 0 en una condición predeterminada; y

cuando la duración acumulada alcanza un primer umbral, determinar (603), mediante el dispositivo, que la contrapresión de paquetes ocurre en el puerto PCIe.

Tipo: Patente Internacional (Tratado de Cooperación de Patentes). Resumen de patente/invención. Número de Solicitud: PCT/CN2016/106134.

Solicitante: HUAWEI TECHNOLOGIES CO., LTD..

Nacionalidad solicitante: China.

Dirección: Huawei Administration Building, Bantian, Longgang District Shenzhen, Guangdong 518129 CHINA.

Inventor/es: ZHANG,BIN, CHEN,LIGANG, CHEN,JIAHUAI, XU,LIXIA.

Fecha de Publicación: 8 de Abril de 2020.

Clasificación Internacional de Patentes:

G06F13/20 FISICA. › G06 CALCULO; CONTEO. › G06F PROCESAMIENTO ELECTRICO DE DATOS DIGITALES (sistemas de computadores basados en modelos de cálculo específicos G06N). › G06F 13/00 Interconexión o transferencia de información u otras señales entre memorias, dispositivos de entrada/salida o unidades de procesamiento (circuitos de interfaz para dispositivos de entrada/salida específicos G06F 3/00; sistemas multiprocesadores G06F 15/16). › para el acceso al bus de entrada/salida.
G06F13/40 G06F 13/00 […] › Estructura del bus.
G06F13/42 G06F 13/00 […] › Protocolo de transferencia para bus, p. ej. interbloqueo; Sincronización.
H04L12/861 ELECTRICIDAD. › H04 TECNICA DE LAS COMUNICACIONES ELECTRICAS. › H04L TRANSMISION DE INFORMACION DIGITAL, p. ej. COMUNICACION TELEGRAFICA (disposiciones comunes a las comunicaciones telegráficas y telefónicas H04M). › H04L 12/00 Redes de datos de conmutación (interconexión o transferencia de información o de otras señales entre memorias, dispositivos de entrada/salida o unidades de tratamiento G06F 13/00). › Organización del almacenamiento de los paquetes en memorias intermedias (buffering) o de su ordenamiento en colas; Planificación de colas.

PDF original: ES-2796609_T3.pdf

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