Multiplexor de cambio de nivel de alta velocidad.
Un multiplexor de cambio de nivel (810), que comprende:
un primer circuito de reducción de tensión (420) acoplado a un primer nodo y que tiene una primera y una segunda entrada,
donde el primer circuito de reducción de tensión (420) está configurado para seleccionar una de las primera y segunda entradas en base a una o más señales de selección, para reducir la tensión del primer nodo si se selecciona la primera entrada y se lleva a un primer estado, y para reducir la tensión del primer nodo si se selecciona la segunda entrada y se lleva a un segundo estado;
un segundo circuito de reducción de tensión (430) acoplado a un segundo nodo y que tiene una tercera y una cuarta entrada, donde el segundo circuito de reducción de tensión (430) está configurado para seleccionar una de las tercera y cuarta entradas en base a la una o más señales de selección, para reducir la tensión del segundo nodo si se selecciona la tercera entrada y se lleva a un tercer estado, y para reducir la tensión del segundo nodo si se selecciona la cuarta entrada y se lleva a un cuarto estado;
un circuito de elevación de tensión (412) configurado para elevar la tensión del primer nodo si se reduce la tensión del segundo nodo mediante el segundo circuito de reducción de tensión (430), y para elevar la tensión del segundo nodo si se reduce la tensión del primer nodo mediante el primer circuito de reducción de tensión (420), donde el circuito de elevación de tensión comprende:
un primer transistor (415) configurado para elevar la tensión del primer nodo si se reduce la tensión del segundo nodo mediante el segundo circuito de reducción de tensión (430), donde el primer transistor (415) tiene una puerta acoplada al segundo nodo;
y un segundo transistor (417) configurado para elevar la tensión del segundo nodo si se reduce la tensión del primer nodo mediante el primer circuito de reducción de tensión (420), donde el segundo transistor (417) tiene una puerta acoplada al primer nodo; y
un circuito estrangulador (815) configurado para reducir la corriente desde un raíl de alimentación al primer transistor (415) si se selecciona la primera entrada y se excita al primer estado.
Tipo: Patente Internacional (Tratado de Cooperación de Patentes). Resumen de patente/invención. Número de Solicitud: PCT/US2015/054307.
Solicitante: QUALCOMM INCORPORATED.
Nacionalidad solicitante: Estados Unidos de América.
Dirección: 5775 MOREHOUSE DRIVE SAN DIEGO, CA 92121-1714 ESTADOS UNIDOS DE AMERICA.
Inventor/es: BOWLES,KEVIN ROBERT, CORONA,JOSE GABRIEL, BOYNAPALLI,VENUGOPAL.
Fecha de Publicación: .
Clasificación Internacional de Patentes:
- H03K17/00 ELECTRICIDAD. › H03 CIRCUITOS ELECTRONICOS BASICOS. › H03K TECNICA DE IMPULSO (medida de las características de los impulsos G01R; modulación de oscilaciones sinusoidales por impulsos H03C; transmisión de información digital, H04L; circuitos discriminadores de detección de diferencia de fase entre dos señales de conteo o integración de ciclos de oscilación H03D 3/04; control automático, arranque, sincronización o estabilización de generadores de oscilaciones o de impulsos electrónicos donde el tipo de generador es irrelevante o esta sin especificar H03L; codificación, decodificación o conversión de código, en general H03M). › Conmutación o apertura de puerta electrónica, es decir, por otros medios distintos al cierre y apertura de contactos (amplificadores controlados H03F 3/72; disposiciones de conmutación para los sistemas de centrales que utilizan dispositivos estáticos H04Q 3/52).
- H03K19/0185 H03K […] › H03K 19/00 Circuitos lógicos, es decir, teniendo al menos dos entradas que actúan sobre una salida (circuitos para sistemas de computadores que utilizan la lógica difusa G06N 7/02 ); Circuitos de inversión. › utilizando únicamente transistores de efecto de campo.
- H03K3/356 H03K […] › H03K 3/00 Circuitos para la generación de impulsos eléctricos; Circuitos monoestables, biestables o multiestables (H03K 4/00 tiene prioridad; para generadores de funciones digitales en ordenadores G06F 1/02). › Circuitos biestables.
PDF original: ES-2803080_T3.pdf
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