Dispositivo y procedimiento para el procesamiento de cuadros de datos en serie.

Dispositivo para el procesamiento de cuadros de datos en serie,

que comprende una unidad de convertidor en serie-paralelo (42, 142), una unidad de evaluación (48, 148) y al menos dos registros de datos (44, 45, 144, 145, 146, 160), en el que

• a la unidad de convertidor en serie-paralelo (42, 142) se alimentan cuadros de datos en serie (F, F1-F9) y desde la unidad de convertidor en serie-paralelo (42, 142) se convierten bloques de datos en serie (A, B, P1, P2A, P2B, P2C), que están contenidos en los cuadros de datos en serie (F, F1-F9), en bloques de datos paralelos (A, B, P1, P2A, P2B, P2C) y se pueden emitir a los registros de datos (44, 45, 144, 145, 146, 160),

• los bloques de datos paralelos (A, B, P1, P2A, P2B, P2C) se pueden registrar en los registros de datos (44, 45, 144, 145, 146, 160) y se pueden emitir desde éstos para el procesamiento siguiente a una unidad de procesamiento (50, 150) y

• a la unidad de evaluación (48, 148) son alimentados de la misma manera los cuadros de datos en serie (F, F1-F9) y la unidad de evaluación (48 48) puede controlar el registro de los bloques de datos en paralelo (A, B, P1, P2A, P2B, P2C) en los registros de datos (44, 45, 144, 145, 146, 160) en función de los contenidos de los cuadros de datos en serie (F, F1-F9),

caracterizado porque para el registro de n bloques de datos A, B, P2A, P2B, P2C) coherentes, que contienen conjuntamente la información sobre un valor a transmitir, están previstos n registros de datos (44, 45, 144, 145, 146) y desde la unidad de evaluación (48, 148) se puede modificar cíclicamente la asociación de los n bloques de datos (A, B, P2A, P2B, P2C) coherentes en los n registros de datos (44, 45, 144, 145, 146), en los que se registran, de manera que n es un número natural mayor o igual a dos.

Tipo: Patente Europea. Resumen de patente/invención. Número de Solicitud: E16165209.

Solicitante: DR. JOHANNES HEIDENHAIN GMBH.

Nacionalidad solicitante: Alemania.

Dirección: DR. JOHANNES-HEIDENHAIN-STRASSE 5 83301 TRAUNREUT ALEMANIA.

Inventor/es: VON BERG,MARTIN.

Fecha de Publicación: 11 de Octubre de 2018.

Clasificación Internacional de Patentes:

G05B19/042 FISICA. › G05 CONTROL; REGULACION. › G05B SISTEMAS DE CONTROL O DE REGULACION EN GENERAL; ELEMENTOS FUNCIONALES DE TALES SISTEMAS; DISPOSITIVOS DE MONITORIZACION O ENSAYOS DE TALES SISTEMAS O ELEMENTOS (dispositivos de maniobra por presión de fluido o sistemas que funcionan por medio de fluidos en general F15B; dispositivos obturadores en sí F16K; caracterizados por particularidades mecánicas solamente G05G; elementos sensibles, ver las subclases apropiadas, p. ej. G12B, las subclases de G01, H01; elementos de corrección, ver las subclases apropiadas, p. ej. H02K). › G05B 19/00 Sistemas de control por programa (aplicaciones específicas, ver los lugares apropiados, p. ej. A47L 15/46; relojes que implican medios anejos o incorporados que permiten hacer funcionar un dispositivo cualquiera en un momento elegido de antemano o después de un intervalo de tiempo predeterminado G04C 23/00; marcado o lectura de soportes de registro con una información digital G06K; registro de información G11; interruptores horarios o de programa horario que se paran automáticamente cuando el programa se ha realizado H01H 43/00). › que utilizan procesadores digitales (G05B 19/05 tiene prioridad).
G11C29/00 G […] › G11 REGISTRO DE LA INFORMACION. › G11C MEMORIAS ESTATICAS (dispositivos semiconductores para memorias H01L, p. ej. H01L 27/108 - H01L 27/11597). › Verificación del funcionamiento correcto de memorias; Ensayo de memorias durante su funcionamiento fuera de línea (offline")o en espera ("standby").
G11C5/06 G11C […] › G11C 5/00 Detalles de memorias cubiertos por el grupo G11C 11/00. › Disposiciones para interconectar eléctricamente elementos de almacenamiento, p. ej. por cableado.
G11C7/10 G11C […] › G11C 7/00 Disposiciones para escribir una información o para leer una información en una memoria digital (G11C 5/00 tiene prioridad; circuitos auxiliares para memorias que utilizan dispositivos semiconductores G11C 11/4063, G11C 11/413, G11C 11/4193). › Disposiciones de interfaz para entrada/salida [I/O] de datos, p. ej. circuitos de control de entrada/salida [I/O] de datos, memorias intermedias de entrada/salida [I/O] de datos.
H04L1/24 ELECTRICIDAD. › H04 TECNICA DE LAS COMUNICACIONES ELECTRICAS. › H04L TRANSMISION DE INFORMACION DIGITAL, p. ej. COMUNICACION TELEGRAFICA (disposiciones comunes a las comunicaciones telegráficas y telefónicas H04M). › H04L 1/00 Disposiciones para detectar o evitar errores en la información recibida. › Ensayos para asegurar el funcionamiento correcto.

PDF original: ES-2685857_T3.pdf

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