Circuito de retardo programable con resolución de tiempo de enteros y fraccional.

Un aparato (210), que comprende:

medios para retardar (310,

410) una señal de entrada por un primer retardo de un número entero de unidades de tiempo; y

medios para retardar (320, 330, 500, 600) más la señal de entrada por un segundo retardo de una fracción de una unidad de tiempo en base a una carga adicional proporcionada por al menos una puerta lógica simulada (518; 618), en la que los medios para retardar más la señal de entrada por el segundo retardo comprenden:

medios para pasar (510, 512, 516, 610, 612, 616) la señal de entrada a través de una primera trayectoria sin la carga adicional si no se selecciona el segundo retardo,

medios para pasar (510, 514, 516, 610, 614, 616) la señal de entrada a través de una segunda trayectoria con la carga adicional acoplada a la segunda trayectoria si se selecciona el segundo retardo; y

un segundo circuito de retardo que comprende la primera trayectoria que proporciona un retardo más corto cuando se selecciona la primera trayectoria, proporcionando la segunda trayectoria un retardo más largo cuando se selecciona la segunda trayectoria y estando acoplada al menos una puerta lógica simulada a la segunda trayectoria y proporcionando una carga adicional para obtener el retardo más largo para la segunda trayectoria;

en el que la primera trayectoria comprende unas primera y segunda puertas lógicas, la segunda trayectoria comprende la segunda puerta lógica y una tercera puerta lógica, y al menos una puerta lógica simulada está acoplada a la tercera puerta lógica;

caracterizado por que al menos una puerta lógica simulada es del mismo tipo de puerta lógica que las primera, segunda y tercera puertas lógicas.

Tipo: Patente Internacional (Tratado de Cooperación de Patentes). Resumen de patente/invención. Número de Solicitud: PCT/US2008/087545.

Solicitante: QUALCOMM INCORPORATED.

Nacionalidad solicitante: Estados Unidos de América.

Dirección: Attn: International IP Administration 5775 Morehouse Drive San Diego, California 92121-1714 ESTADOS UNIDOS DE AMERICA.

Inventor/es: KESKIN,MUSTAFA, PEDRALI-NOY,MARZIO.

Fecha de Publicación: .

Clasificación Internacional de Patentes:

  • H03K5/13 SECCION H — ELECTRICIDAD.H03 CIRCUITOS ELECTRONICOS BASICOS.H03K TECNICA DE IMPULSO (medida de las características de los impulsos G01R; modulación de oscilaciones sinusoidales por impulsos H03C; transmisión de información digital, H04L; circuitos discriminadores de detección de diferencia de fase entre dos señales de conteo o integración de ciclos de oscilación H03D 3/04; control automático, arranque, sincronización o estabilización de generadores de oscilaciones o de impulsos electrónicos donde el tipo de generador es irrelevante o esta sin especificar H03L; arranque, sincronización o estabilización de generadores cuando el tipo de generadores es indiferente o no especificado H03L; codificación, decodificación o conversión de código, en general H03M). › H03K 5/00 Manipulación de impulsos no cubiertos por ninguno de los otros grupos principales de la presente subclase (circuitos de realimentación H03K 3/00, H03K 4/00; utilizando dispositivos magnéticos o eléctricos no lineales H03K 3/45). › Disposiciones que tienen una salida única y transforman la señal de entrada en impulsos transmitidos en intervalos de tiempo deseados.

PDF original: ES-2648893_T3.pdf

 

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