Sistema de Ejecución Determinista en Tiempo, Distribuida y Sincronizada para Aplicaciones de Control, Test y Medida.

Sistema de ejecución determinista en tiempo, distribuida y sincronizada para aplicaciones de control,

test y medida.

Sistema de ejecución determinista en tiempo distribuida sincronizada para módulos (M0, ..., Mn) de control, test y medida que comparten al menos una señal de disparo y una señal de reloj, y que comprenden un procesador determinista en tiempo (100), que usa la señal de reloj y una o más de las señales de disparo compartidas por todos los módulos (M0, ..., Mn) para ejecutar un programa distribuido en los módulos (MO, ..., Mn) con control preciso del instante de ejecución de cada instrucción y para sincronizar la ejecución de todos o parte del conjunto de módulos (M0, ..., Mn). El procesador determinista en tiempo (100) se comunica con un bus de señales (120) común a todos los módulos (M0, ..., Mn), que comprende un bus de control (120a) donde comparten las señales de reloj y disparo. Opcionalmente, el bus de señales (120) incluye un bus de comunicación (120b) con el que se comunica el procesador determinista en tiempo (100) y también los módulos (M0, ..., Mn) entre sí y, opcionalmente, con un procesador u ordenador externo (130).

Tipo: Patente de Invención. Resumen de patente/invención. Número de Solicitud: P201531155.

Solicitante: SIGNADYNE SPAIN, S.L.

Nacionalidad solicitante: España.

Inventor/es: OLIVERIO,Néstor Hugo, ALMENDROS PARRA,Marc.

Fecha de Publicación: .

Clasificación Internacional de Patentes:

  • G06F13/42 SECCION G — FISICA.G06 COMPUTO; CALCULO; CONTEO.G06F TRATAMIENTO DE DATOS DIGITALES ELECTRICOS (computadores en los que una parte del cálculo se efectúa hidráulica o neumáticamente G06D, ópticamente G06E; sistemas de computadores basados en modelos de cálculo específicos G06N). › G06F 13/00 Interconexión o transferencia de información u otras señales entre memorias, dispositivos de entrada/salida o unidades de tratamiento (circuitos de interfaz para dispositivos de entrada/salida específicos G06F 3/00; sistemas multiprocesadores G06F 15/16). › Protocolo de transferencia para bus, p. ej. interbloqueo; Sincronización.

PDF original: ES-2552739_A1.pdf

 

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