APARATO Y PROCEDIMIENTO DE SUPERPOSICION PARA LA EMISION DE UNA IMAGEN GRAFICA TRIDIMENSIONAL POR ORDENADORES.
Aparato de superposición para la emisión de una imagen 3DCG, que comprende:
una placa de acelerador gráfico tridimensional (1) para formar una imagen 3DCG mediante la interpretación (S2) de los datos de una imagen 3DCG; y una placa de elemento de superposición (2) para formar una imagen de emisión sobre la cual se superpone dicha imagen 3DCG mediante la mezcla (S6) de dicha imagen 3DCG formada mediante dicho acelerador gráfico tridimensional (1) con una señal de televisión de entrada; estando construidos dicha placa de acelerador gráfico tridimensional (1) y dicha placa de elemento de superposición (2) para operar al mismo tiempo; en el que un marco que se mezcla en dicha placa de elemento de superposición es un marco previo avanzado en un marco desde un marco que se interpreta al mismo tiempo en dicha placa de acelerador gráfico informático tridimensional (1), comprendiendo también el aparato de superposición: una memoria de sistema (3) dispuesta entre la placa de acelerador gráfico tridimensional (1) y la placa de elemento de superposición (2) y que comprende dos bancos de memoria (3A, 3B) configurados respectivamente para almacenar marcos; una primera CPU (4) configurada para hacer que la placa de acelerador gráfico tridimensional (1) inicie un proceso de interpretación (S2) y hacer que la memoria del sistema (3) lea la imagen 3DCG almacenada en una memoria de marcos en la placa de acelerador gráfico tridimensional (1); una segunda CPU (5) configurada para operar un proceso de mezcla previa (S5) para mezclar la imagen 3DCG (S4) leída desde la memoria del sistema (3) y para operar un proceso de mezcla (S6) según una señal de entrada de televisión; y una tercera CPU (7) configurada para controlar el proceso básico del aparato de superposición; en el que la segunda CPU (5) está también configurada para conmutar un indicador (8) para cambiar el banco de memoria (3A, 3B) y permitir que la primera CPU (4) haga que la placa de acelerador gráfico tridimensional (1) inicie el proceso de interpretación (S2); y en el que la primera CPU (14) esto también configurada para hacer que la imagen 3DCG almacenada en la memoria de marcos se transmita al respectivo banco de memoria (3A, 3B) determinado mediante el indicador (8) y esperar el permiso de la segunda CPU (5) para hacer que la placa de acelerador gráfico tridimensional (1) inicie el proceso de interpretación (S2).
Tipo: Resumen de patente/invención.
Solicitante: KABUSHIKI KAISHA MICRONET.
Nacionalidad solicitante: Japón.
Dirección: 1-11, NISHI 15-CHOME, MINAMI 10-JO, CHUO-KU,SAPPORO.
Inventor/es: MURAKAMI,KOZO.
Fecha de Publicación: .
Fecha Solicitud PCT: 25 de Julio de 2002.
Fecha Concesión Europea: 24 de Diciembre de 2008.
Clasificación PCT:
- G06T15/40 FISICA. › G06 CALCULO; CONTEO. › G06T TRATAMIENTO O GENERACIÓN DE DATOS DE IMAGEN, EN GENERAL. › G06T 15/00 Interpretación de imagines 3D [Tridimensionales]. › Supresión de partes escondidas.
Países PCT: Austria, Bélgica, Suiza, Alemania, Dinamarca, España, Francia, Reino Unido, Grecia, Italia, Liechtensein, Luxemburgo, Países Bajos, Suecia, Mónaco, Portugal, Irlanda, Eslovenia, Finlandia, Rumania, Chipre, Lituania, Letonia, Ex República Yugoslava de Macedonia, Albania.
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