MATRIZ DE CONMUTADORES BINARIOS CON TOLERANCIA DE AVERIAS.
Matriz de conmutadores con dos posiciones cada una que permite transferir m señales entrantes a m salidas,
estando la matriz destinada para soportar averías de bloqueo de los conmutadores, siendo el accionamiento de la matriz tal que todas las disposiciones de m señales entrantes sean posibles en m salidas, comprendiendo la matriz una matriz principal (20) y una matriz de recuperación (22, 221), comprendiendo la indicada matriz de recuperación un número de entradas y un idéntico número de salidas, siendo el indicado número de entradas y salidas de la indicada matriz de recuperación al menos igual al número más pequeño de las n y p, siendo n el número de entradas de la matriz principal, y p el número de salidas de la indicada matriz principal, caracterizada porque los conmutadores de la indicada matriz de recuperación están dispuestos y accionados de forma tal que la misma actúa como un simple conmutador del cual las entradas están constituidas por cualquier par (e''i, e''j) de entradas de la indicada matriz de recuperación y del cual las dos salidas están constituidas por las dos salidas (s'' i, s'' j) de la indicada matriz de recuperación que tienen el mismo rango que el indicado par de entradas, estando las otras entradas de la matriz de recuperación conectadas con las salidas del mismo rango de la indicada matriz principal y porque la indicada matriz de recuperación comprende un número de conmutadores (521,...52p) que es igual al número de entradas y de salidas de esta matriz montados de forma tal que la primera entrada (54 i) y la primera salida (56 i) del conmutador de rango i constituyan, respectivamente, la entrada y la salida de rango i de esta matriz de recuperación, estando la segunda entrada (58 i) de cada conmutador conectada con la segunda salida (60i+1) del conmutador de rango inmediatamente superior, y estando la segunda salida (601) del conmutador de rango 1 conectada con la segunda entrada (58p) del conmutador de rango n o p.
Tipo: Resumen de patente/invención.
Solicitante: ALCATEL LUCENT.
Nacionalidad solicitante: Francia.
Dirección: 54 RUE LA BOETIE,75008 PARIS.
Inventor/es: DARROT,ERIC, VAILLANT,BRUNO.
Fecha de Publicación: .
Fecha Solicitud PCT: 6 de Diciembre de 1999.
Fecha Concesión Europea: 6 de Mayo de 2009.
Clasificación PCT:
- H04L12/56
- H04Q11/04 ELECTRICIDAD. › H04 TECNICA DE LAS COMUNICACIONES ELECTRICAS. › H04Q SELECCION (conmutadores, relés, selectores H01H; redes de comunicación inalámbricas H04W). › H04Q 11/00 Dispositivos de selección para sistemas multiplex (sistemas multiplex H04J). › para multiplex de división de tiempo.
- H04Q3/68 H04Q […] › H04Q 3/00 Dispositivos de selección (H04Q 5/00 - H04Q 11/00 tienen prioridad). › para agrupar o entrelazar grupos o etapas de selectores.
Países PCT: Austria, Bélgica, Suiza, Alemania, Dinamarca, España, Francia, Reino Unido, Grecia, Italia, Liechtensein, Luxemburgo, Países Bajos, Suecia, Mónaco, Portugal, Irlanda, Eslovenia, Finlandia, Rumania, Chipre, Lituania, Letonia, Ex República Yugoslava de Macedonia, Albania.
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