Sistemas y procedimientos de implementación de validación de contenido de circuitos basados en microordenadores.
Un procedimiento de validación remota de contenido de memoria sobre uno o más circuitos (350A,
350B, 350C, 350D) objetivo que ejecutan al menos una aplicación, que comprende:
asociar al menos un instrumento (120A, 120C) de escaneo JTAG con uno o más puertos (360A, 360C) de diagnóstico JTAG de un sistema de microordenador local que incluye al menos uno de los circuitos (350A, 350C) objetivo;
asociar al menos un instrumento (120B, 120D) de escaneo no JTAG con uno o más puertos (360D) de diagnóstico no JTAG del sistema de microordenador local que incluye al menos uno de los circuitos (350D) objetivo;
realizar un proceso de escaneo distinto de un proceso de escaneo de límites, a través de al menos un instrumento (120A, 120C) de escaneo JTAG y al menos un instrumento (120B, 120D) de escaneo no JTAG, a través del acceso a al menos un elemento de almacenamiento asociado con al menos uno de los circuitos (350A, 350B, 350C, 350D) objetivo a través de uno o más puertos (360A, 360C) de diagnóstico JTAG y uno o más puertos (360D) de diagnóstico no JTAG para obtener datos del sistema durante la operación de la aplicación o aplicaciones, respectivamente, operar sobre uno o más circuitos (350A, 350B, 350C, 350D) objetivo, el proceso de escaneo que incluye:
parar la aplicación o aplicaciones en ejecución, respectivamente, operar sobre uno o más circuitos (350A, 350B, 50C, 350D) objetivo; y
leer el contenido relacionado a la aplicación o aplicaciones en ejecución, respectivamente, desde al menos un elemento de almacenamiento en el proceso de escaneo distinto de un proceso de escaneo de límites para obtener datos de prueba mientras que se para la aplicación o aplicaciones,
respectivamente;
reanudar la operación de la aplicación o aplicaciones en ejecución desde el estado en el que se pararon la aplicación o aplicaciones en ejecución, respectivamente;
transmitir información de descripción de los datos de prueba a un sitio remoto; y
comparar, en el sitio remoto, la información con información conocida para confirmar la configuración y/u operación del sistema deseada.
Tipo: Patente Internacional (Tratado de Cooperación de Patentes). Resumen de patente/invención. Número de Solicitud: PCT/US2012/034735.
Solicitante: Electronic Warfare Associates, Inc.
Nacionalidad solicitante: Estados Unidos de América.
Dirección: 13873 Park Center Road, Suite 500 Herndon, VA 20171 ESTADOS UNIDOS DE AMERICA.
Inventor/es: LA FEVER,GEORGE BERNARD, FLAUM,ISER B.
Fecha de Publicación: .
Clasificación Internacional de Patentes:
- G01R31/3177 FISICA. › G01 METROLOGIA; ENSAYOS. › G01R MEDIDA DE VARIABLES ELECTRICAS; MEDIDA DE VARIABLES MAGNETICAS (indicación de la sintonización de circuitos resonantes H03J 3/12). › G01R 31/00 Dispositivos para ensayo de propiedades eléctricas; Dispositivos para la localización de fallos eléctricos; Disposiciones para el ensayo eléctrico caracterizadas por lo que se está ensayando, no previstos en otro lugar (ensayo o medida de dispositivos semiconductores o de estado sólido, durante la fabricación H01L 21/66; ensayo de los sistemas de transmisión por líneas H04B 3/46). › Ensayo del funcionamiento lógico, p. ej. por medio de analizadores lógicos.
- G06F21/57 G […] › G06 CALCULO; CONTEO. › G06F PROCESAMIENTO ELECTRICO DE DATOS DIGITALES (sistemas de computadores basados en modelos de cálculo específicos G06N). › G06F 21/00 Disposiciones de seguridad para la protección de computadores, sus componentes, programas o datos contra actividades no autorizadas. › Certificados o mantenimiento de plataformas informáticas de confianza, p. ej.: recuperación de seguridad o power-downs, controles, control de versión del software del sistema, actualizaciones de seguridad o valoración de vulnerabilidades.
PDF original: ES-2805334_T3.pdf
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