Métodos de adaptación de velocidad para códigos LDPC.

Método de adaptación de velocidad de producción de un conjunto de bits codificados a partir de un conjunto de bits de información para la transmisión entre un primer nodo (110,

115) y un segundo nodo (110, 115) en un sistema (100) de comunicaciones inalámbricas, comprendiendo el método:

generar (904) un vector de palabra de código codificando el conjunto de bits de información con un código de verificación de paridad de baja densidad cuasicíclico, QC-LDPC, en el que el vector de palabra de código se compone de bits sistemáticos y bits de paridad; y

realizar (908) adaptación de velocidad basada en memoria intermedia circular en el vector de palabra de código generado para producir los bits codificados para la transmisión,

en el que generar un vector de palabra de código codificando el conjunto de bits de información con un QC-LDPC comprende:

unir bits ficticios al conjunto de bits de información para producir un vector de información U; y

codificar el vector de información U con la matriz de verificación de paridad H del QC-LDPC para generar el vector de palabra de código, en el que el código QC-LDPC está diseñado con el conocimiento de que la primera pluralidad de bits sistemáticos se perforarán,

y en el que realizar la adaptación de velocidad basada en memoria intermedia circular en el vector de palabra de código generado para producir los bits codificados para la transmisión comprende:

perforar una primera pluralidad de bits sistemáticos al no escribir la primera pluralidad perforada de bits sistemáticos en la memoria intermedia circular,

retirar los bits ficticios, y

producir un vector para la transmisión.

Tipo: Patente Internacional (Tratado de Cooperación de Patentes). Resumen de patente/invención. Número de Solicitud: PCT/IB2017/054889.

Solicitante: TELEFONAKTIEBOLAGET LM ERICSSON (PUBL).

Inventor/es: ANDERSSON, MATTIAS, BLANKENSHIP,YUFEI, SANDBERG,SARA.

Fecha de Publicación: .

Clasificación Internacional de Patentes:

  • H03M13/00 SECCION H — ELECTRICIDAD.H03 CIRCUITOS ELECTRONICOS BASICOS.H03M CODIFICACION, DECODIFICACION O CONVERSION DE CODIGO, EN GENERAL (por medio de fluidos F15C 4/00; convertidores ópticos analógico/digitales G02F 7/00; codificación, decodificación o conversión de código especialmente adaptada a aplicaciones particulares, ver las subclases apropiadas, p. ej. G01D, G01R, G06F, G06T, G09G, G10L, G11B, G11C, H04B, H04L, H04M, H04N; cifrado o descifrado para la criptografía o para otros fines que implican la necesidad de secreto G09C). › Codificación, decodificación o conversión de código para detectar o corregir errores; Hipótesis básicas sobre la teoría de codificación; Límites de codificación; Métodos de evaluación de la probabilidad de error; Modelos de canal; Simulación o prueba de códigos (detección o correción de errores para la conversión de código o la conversión analógico/digital, digital/analógica H03M 1/00 - H03M 11/00; especialmente adaptados para los computadores digitales G06F 11/08, para el registro de la información basado en el movimiento relativo entre el soporte de registro y el transductor G11B, p. ej. G11B 20/18, para memorias estáticas G11C).
  • H03M13/11 H03M […] › H03M 13/00 Codificación, decodificación o conversión de código para detectar o corregir errores; Hipótesis básicas sobre la teoría de codificación; Límites de codificación; Métodos de evaluación de la probabilidad de error; Modelos de canal; Simulación o prueba de códigos (detección o correción de errores para la conversión de código o la conversión analógico/digital, digital/analógica H03M 1/00 - H03M 11/00; especialmente adaptados para los computadores digitales G06F 11/08, para el registro de la información basado en el movimiento relativo entre el soporte de registro y el transductor G11B, p. ej. G11B 20/18, para memorias estáticas G11C). › usando bits de paridad múltiple.

PDF original: ES-2787907_T3.pdf

 

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