Implementación de modo dinámico de baja potencia para dispositivos informáticos.

Un procedimiento para conservar energía en un dispositivo informático que tiene al menos un procesador,

que comprende:

establecer (14) un bit de indicador asociado con un recurso, en el que el recurso es uno de una pluralidad de recursos utilizados por un procesador;

identificar (28) los recursos que se pueden colocar en un modo de baja potencia basándose en la configuración de bit de indicador;

registrar (30) un requisito de latencia para cada uno de los recursos identificados;

seleccionar (30) un requisito de latencia más corto entre los requisitos de latencia registrados;

evaluar (38) en los modos de baja potencia del dispositivo informático para cada recurso que se pueda colocar en un modo de baja potencia para eliminar cualquier modo de recurso de baja potencia o cualquier combinación de modos de recurso de baja potencia que tengan un requisito de latencia combinado que exceda el requisito de latencia más corto seleccionado;

seleccionar (38) una combinación de modos de recurso de baja potencia que maximice los ahorros de energía potenciales y tenga un requisito de latencia total que sea menor o igual al requisito de latencia más corto seleccionado; y

entrar (40) en la combinación seleccionada de modos de recurso de baja potencia ejecutando una función de entrada de cada uno de los modos de baja potencia seleccionados en cada uno de los recursos identificados;

caracterizado por que el paso de establecer (14) el bit de indicador asociado con un recurso se realiza cuando el recurso no está en uso y el paso de identificar (28) los recursos que pueden colocarse en un modo de baja potencia basándose en la configuración de bit de indicador se realiza cuando el procesador puede entrar en un estado de inactividad.

Tipo: Patente Internacional (Tratado de Cooperación de Patentes). Resumen de patente/invención. Número de Solicitud: PCT/US2011/020710.

Solicitante: QUALCOMM INCORPORATED.

Nacionalidad solicitante: Estados Unidos de América.

Dirección: Attn: International IP Administration 5775 Morehouse Drive San DiegoCalifornia 92121 ESTADOS UNIDOS DE AMERICA.

Inventor/es: GARGASH,NORMAN S, FRANTZ,ANDREW J, SALSBERY,BRIAN J, BARRETT,CHRISTOPHER A.

Fecha de Publicación: .

Clasificación Internacional de Patentes:

  • G06F1/20 SECCION G — FISICA.G06 COMPUTO; CALCULO; CONTEO.G06F TRATAMIENTO DE DATOS DIGITALES ELECTRICOS (computadores en los que una parte del cálculo se efectúa hidráulica o neumáticamente G06D, ópticamente G06E; sistemas de computadores basados en modelos de cálculo específicos G06N). › G06F 1/00 Detalles no cubiertos en los grupos G06F 3/00 - G06F 13/00 y G06F 21/00 (arquitecturas de computadores universales con programas grabados G06F 15/76). › Medios de enfriamiento.
  • G06F1/32 G06F 1/00 […] › Medios destinados a economizar energía.

PDF original: ES-2646663_T3.pdf

 

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