CONTROL DE CONEXION EN ACTIVO DE SISTEMA DE ORDENADOR BASADO EN PROCESADORES MULTIPLES.
Un método para el mantenimiento de un sistema de ordenador sin interrumpir la operación del sistema de ordenador,
que comprende las etapas de: conectar al menos un componente de ordenador (32) a una placa o cuadro del sistema de ordenador, teniendo el componente de ordenador una entrada de voltaje; detectar la conexión del componente de ordenador (32) a la placa utilizando un circuito de control (34) del sistema del ordenador; suministrar energía a la entrada de voltaje (Vent) del componente de ordenador (32) en respuesta a la mencionada etapa de detección; y controlar la energía suministrada a la entrada de voltaje (Vent) del componente de ordenador (32); caracterizado porque el método incluye: conectar al menos un componente (32) no periférico enchufado en caliente del sistema de ordenador en un conectador en una placa del sistema perteneciente al sistema del ordenador, habilitar un circuito (36) de inicio suave individual para activar suavemente el voltaje de energía dirigido a cada componente conectado a la placa del sistema y controlar individualmente la energía suministrada; y utilizar una serie o conjunto de puertas programable (38) que incluye la lógica de control (35) de inicio suave adaptada para recibir las señales de detección de presencia de los circuitos de inicio suave (36), que indica la presencia de componentes conectados a la placa del sistema, y responder a la presencia de señales de detección de presencia mediante el suministro de señales de encendido/apagado para habilitar los circuitos de inicio suave individuales, y la lógica de control (37) de fallos para responder a las señales de fallos desde los circuitos de inicio suave para suministrar señales de reposición a cero a los circuitos de inicio suave.
Tipo: Resumen de patente/invención.
Solicitante: INTERNATIONAL BUSINESS MACHINES CORPORATION
IBM UNITED KINGDOM LIMITED.
Nacionalidad solicitante: Estados Unidos de América.
Dirección: OLD ORCHARD ROAD,ARMONK, N.Y. 10504.
Inventor/es: JOHARI, GIRISH, CHANDRA, THOMSEN, PETER, MATTHEW, WALTER, LUCINDA, MAE, MUELLER, MARK, WAYNE.
Fecha de Publicación: .
Fecha Solicitud PCT: 24 de Marzo de 2000.
Fecha Concesión Europea: 7 de Mayo de 2003.
Clasificación Internacional de Patentes:
- G06F13/40 FISICA. › G06 CALCULO; CONTEO. › G06F PROCESAMIENTO ELECTRICO DE DATOS DIGITALES (sistemas de computadores basados en modelos de cálculo específicos G06N). › G06F 13/00 Interconexión o transferencia de información u otras señales entre memorias, dispositivos de entrada/salida o unidades de procesamiento (circuitos de interfaz para dispositivos de entrada/salida específicos G06F 3/00; sistemas multiprocesadores G06F 15/16). › Estructura del bus.
Países PCT: Austria, Bélgica, Suiza, Alemania, Dinamarca, España, Francia, Reino Unido, Grecia, Italia, Liechtensein, Luxemburgo, Países Bajos, Suecia, Mónaco, Portugal, Irlanda, Eslovenia, Finlandia, Rumania, Chipre, Oficina Europea de Patentes, Lituania, Letonia, Ex República Yugoslava de Macedonia, Albania, Armenia, Azerbayán, Bielorusia, Ghana, Gambia, Kenya, Kirguistán, Kazajstán, Lesotho, República del Moldova, Malawi, Federación de Rusia, Sudán, Sierra Leona, Tayikistán, Turkmenistán, República Unida de Tanzania, Uganda, Zimbabwe, Burkina Faso, Benin, República Centroafricana, Congo, Costa de Marfil, Camerún, Gabón, Guinea, Malí, Mauritania, Niger, Senegal, Chad, Togo, Organización Regional Africana de la Propiedad Industrial, Swazilandia, Guinea-Bissau, Organización Africana de la Propiedad Intelectual, Organización Eurasiática de Patentes.
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