BUFFER BIDIRECCIONAL CON ENGANCHE Y CONTROL DE LA PARIDAD.

CIRCUITO PARA ALMACENAR Y CONTROLAR LA PARIDAD DE DATOS DIGITALES COMUNICADOS ENTRE UN PRIMER Y UN SEGUNDO BUSES DE DATOS,

QUE INCLUYE UNA PLURALIDAD DE CIRUITOS BIDIRECCIONALES DE ALMACENAMIENTO INTERMEDIO. CADA UNO DE LOS CIRCUITOS BIDIRECCIONALES DE ALMACENAMIENTO INTERMEDIO INCLUYE UNA VIA DE DATOS QUE CONSTA DE UN RECEPTOR DE DATOS, UN ELEMENTO ENGANCHADOR Y UN EXCITADOR CONECTADOS EN SERIE ENTRE EL PRIMER Y EL SEGUNDO BUSES DE DATOS, RESPECTIVAMENTE; UNA SEGUNDA VIA DE DATOS QUE CONSTA DE UN RECEPTOR DE DATOS, UN ELEMENTO DE ENGANCHE Y UN EXCITADOR CONECTADOS EN SERIE ENTRE EL SEGUNDO Y EL PRIMER BUSES DE DATOS, RESPECTIVAMENTE; UN MECANISMO DE CONTROL PARA CONTROLAR QUE LOS EXCITADORES COLOQUEN SELECTIVAMENTE SU SALIDA EN UN ESTADO DE EXCITACION ACTIVA O DE ALTA IMPEDANCIA; Y UN MECANISMO DE CONTROL PARA CONTROLAR LOS ELEMENTOS DE ENGANCHE DE DATOS PARA ENGANCHARSE O PASAR A TRAVES DE LOS DATOS DE FORMA SELECTIVA. UN CIRCUITO GENERADOR DE PARIDAD ESTA CONECTADO A LA SALIDA DEL ELEMENTO DE ENGANCHE EN LA PRIMERA VIA DE DATOS DE CADA CIRCUITO BIDIRECCIONAL DE ALMACENAMIENTO INTERMEDIO PARA GENERAR UN BIT DE PARIDAD QUE RESPONDA A LOS DATOS DE LA SALIDA DE DICHOS ELEMENTOS DE ENGANCHE. HAY UN CIRCUITO TRANSPARENTE Y EXCITADOR CON DIVISOR DE FASE PARA INCREMENTAR LA VELOCIDAD DEL CIRCUITO SIN INCREMENTAR SUSTANCIALMENTE LAS NECESIDADES DE ENERGIA.

Tipo: Resumen de patente/invención.

Solicitante: INTERNATIONAL BUSINESS MACHINES CORPORATION.

Nacionalidad solicitante: Estados Unidos de América.

Dirección: OLD ORCHARD ROAD,ARMONK, N.Y. 10504.

Inventor/es: DEAN, MARK, EDWARD, BLAND, PATRICK MAURICE, KRAMER, KEVIN GERRARD, TEMPEST, SUSAN LYNN, GAUDENZI, GENE JOSEPH.

Fecha de Publicación: 16 de Octubre de 1995.

Fecha Concesión Europea: 16 de Agosto de 1995.

Clasificación Internacional de Patentes:

G06F11/10 FISICA. › G06 CALCULO; CONTEO. › G06F PROCESAMIENTO ELECTRICO DE DATOS DIGITALES (sistemas de computadores basados en modelos de cálculo específicos G06N). › G06F 11/00 Detección de errores; Corrección de errores; Monitorización (detección, corrección o monitorización de errores en el almacenamiento de información basado en el movimiento relativo entre el soporte de registro y el transductor G11B 20/18; monitorización, es decir, supervisión del progreso del registro o reproducción G11B 27/36; en memorias estáticas G11C 29/00). › añadiendo cifras binarias o símbolos especiales a los datos expresados según un código, p. ej. control de paridad, exclusión de los 9 o de los 11.
G06F13/40 G06F […] › G06F 13/00 Interconexión o transferencia de información u otras señales entre memorias, dispositivos de entrada/salida o unidades de procesamiento (circuitos de interfaz para dispositivos de entrada/salida específicos G06F 3/00; sistemas multiprocesadores G06F 15/16). › Estructura del bus.
H03K19/00 ELECTRICIDAD. › H03 CIRCUITOS ELECTRONICOS BASICOS. › H03K TECNICA DE IMPULSO (medida de las características de los impulsos G01R; modulación de oscilaciones sinusoidales por impulsos H03C; transmisión de información digital, H04L; circuitos discriminadores de detección de diferencia de fase entre dos señales de conteo o integración de ciclos de oscilación H03D 3/04; control automático, arranque, sincronización o estabilización de generadores de oscilaciones o de impulsos electrónicos donde el tipo de generador es irrelevante o esta sin especificar H03L; codificación, decodificación o conversión de código, en general H03M). › Circuitos lógicos, es decir, teniendo al menos dos entradas que actúan sobre una salida (circuitos para sistemas de computadores que utilizan la lógica difusa G06N 7/02 ); Circuitos de inversión.

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