Prueba coordinada.
Un método de implementación de pruebas coordinadas programadas en una memoria de un dispositivo,
que comprende:
en un controlador (302):
a. realizar un análisis de prueba previa (102) utilizando una secuencia de comandos de verificación;
b. iniciar una prueba utilizando una secuencia de comandos de ejecución (104);
c. monitorizar la prueba utilizando una secuencia de comandos de monitorización (108); y
d. realizar análisis posterior al procesamiento (112) utilizando una secuencia de comandos de análisis, en donde la secuencia de comandos de verificación, la secuencia de comandos de monitorización y la secuencia de comandos de análisis utilizan el secuencia de comandos de ejecución como un archivo de datos de descripción de ejecución para especificar un flujo de prueba, cargar información de la función del controlador y desde el cual de una pluralidad de controladores de carga se recuperan datos; lanzar instancias de controlador de carga en una pluralidad de generadores de carga (304), simulando cargas;
en un equilibrador de carga (306), distribuir las cargas simuladas a servidores web (308)
en donde la secuencia de comandos de monitorización monitoriza los controladores de carga, e indica qué están haciendo los controladores de carga durante la prueba, monitoriza una duración de ejecución de la prueba y analiza las características específicas que se están probando.
Tipo: Patente Europea. Resumen de patente/invención. Número de Solicitud: E13175537.
Solicitante: Synchronoss Technologies, Inc.
Nacionalidad solicitante: Estados Unidos de América.
Dirección: 200 Crossing Boulevard Bridgewater, NJ 08807 ESTADOS UNIDOS DE AMERICA.
Inventor/es: CORBESERO,STEPHEN.
Fecha de Publicación: .
Clasificación Internacional de Patentes:
- G06F11/34 FISICA. › G06 CALCULO; CONTEO. › G06F PROCESAMIENTO ELECTRICO DE DATOS DIGITALES (sistemas de computadores basados en modelos de cálculo específicos G06N). › G06F 11/00 Detección de errores; Corrección de errores; Monitorización (detección, corrección o monitorización de errores en el almacenamiento de información basado en el movimiento relativo entre el soporte de registro y el transductor G11B 20/18; monitorización, es decir, supervisión del progreso del registro o reproducción G11B 27/36; en memorias estáticas G11C 29/00). › Registro o evaluación estática de la actividad del computador, p. ej. de las interrupciones o de las operaciones de entrada-salida.
- G06F11/36 G06F 11/00 […] › Prevención de errores probando o depurando el software.
PDF original: ES-2718128_T3.pdf
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