METODO Y APARATO PARA LA REALIZACION DE UN SISTEMA DE RESOLUCION DE BIFURCACIONES EN CUATRO ETAPAS EN UN PROCESADOR INFORMATICO.
EN ESTE INVENTO SE DESCRIBE UN SISTEMA DE RESOLUCION DE INSTRUCCIONES DE BIFURCACION DE CUATRO ETAPAS PARA UN PROCESADOR EN CASCADA.
UNA PRIMERA ETAPA DEL SISTEMA DE RESOLUCION DE INSTRUCCIONES DE BIFURCACION, TAL COMO UNA UNIDAD DE RASTREO DE INSTRUCCIONES QUE PUEDE RASTREAR CONTINUAMENTE INSTRUCCIONES, PREDICE LA EXISTENCIA Y EL RESULTADO DE LAS INSTRUCCIONES DE BIFURCACION DENTRO DE UNA CORRIENTE DE INSTRUCCIONES. UNA SEGUNDA ETAPA DECODIFICA TODAS LAS INSTRUCCIONES RASTREADAS. SI LA ETAPA DE DECODIFICACION DETERMINA QUE UNA INSTRUCCION DE BIFURCACION PREDICHA POR LA PRIMERA ETAPA NO ES UNA INSTRUCCION DE BIFURCACION, LA ETAPA DE DECODIFICACION DESCARGA EL CANAL Y REINICIA EL PROCESADOR EN UNA DIRECCION CORRECTA. LA ETAPA DE DECODIFICACION VERIFICA TODAS LAS PREDICCIONES DE BIFURCACION HECHAS POR LA ETAPA DE PREDICCION DE BIFURCACION. FINALMENTE, LA ETAPA DE DECODIFICACION HACE PREDICCIONES DE BIFURCACION PARA LAS BIFURCACIONES NO PREDICHAS POR LA ETAPA DE PREDICCION DE BIFURCACION. UNA TERCERA ETAPA EJECUTA TODAS LAS INSTRUCCIONES DE BIFURCACION PARA DETERMINAR UN RESULTADO DE BIFURCACION FINAL Y UNA DIRECCION OBJETO DE BIFURCACION FINAL. LA ETAPA DE EJECUCION DE BIFURCACION COMPARA EL RESULTADO DE BIFURCACION FINAL Y LA DIRECCION OBJETO DE BIFURCACION FINAL CON EL RESULTADO DE BIFURCACION PREDICHO Y LA DIRECCION OBJETO DE BIFURCACION PREDICHA PARA DETERMINAR SI EL PROCESADOR DEBE DE DESCARGAR EL EXTREMO DELANTERO DEL CANAL DEL MICROPROCESADOR Y REINICIAR EN UNA DIRECCION CORRECTA. UNA ETAPA FINAL DE RESOLUCION DE BIFURCACION RETIRA TODAS LAS INSTRUCCIONES DE BIFURCACION. LA ETAPA DE ELIMINACION ASEGURA QUE NO SE COMETEN PERMANENTEMENTE EN CUALQUIER INSTRUCCION RASTREADA DESPUES DE UN BIFURCACION MAL PREDICHA.
Tipo: Resumen de patente/invención.
Solicitante: INTEL CORPORATION.
Nacionalidad solicitante: Estados Unidos de América.
Dirección: 2200 MISSION COLLEGE BOULEVARD,SANTA CLARA, CA 95052.
Inventor/es: HOYT, BRADLEY D., HINTON, GLENN J., PAPWORTH, DAVID B., GUPTA, ASHWANI KUMAR, FETTERMAN, MICHAEL ALAN, NATARAJAN, SUBRAMANIAN, SHENOY, SUNIL, D\'SA, REYNOLD V.
Fecha de Publicación: .
Fecha Concesión Europea: 8 de Septiembre de 1999.
Clasificación Internacional de Patentes:
- G06F9/38 FISICA. › G06 CALCULO; CONTEO. › G06F PROCESAMIENTO ELECTRICO DE DATOS DIGITALES (sistemas de computadores basados en modelos de cálculo específicos G06N). › G06F 9/00 Disposiciones para el control por programa, p. ej. unidades de control (control por programa para dispositivos periféricos G06F 13/10). › Ejecución simultánea de instrucciones, p. ej. segmentación, anticipación.
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