Unidad lógica secuencial de múltiples suministros de energía.

Un aparato para mejorar la velocidad de una unidad lógica secuencial que comprende:



una ruta de datos, configurada para recibir una señal de entrada, que incluye puertas lógicas (204-209) configuradas para ser operativas en un primer nivel de suministro de energía (210), estando la ruta de datos configurada para generar una señal de salida, en donde el primer nivel de suministro de energía (210) es un nivel mínimo de tensión operativa de suministro de energía para las puertas lógicas (202, 203) en la ruta de datos; y

una ruta de reloj que incluye puertas lógicas (202, 203) configuradas para funcionar en un segundo nivel de suministro de energía (211), en donde las puertas lógicas (202, 203) de la ruta de reloj generan una señal de muestreo configurada para efectuar el muestreo de la señal de entrada con el fin de generar la señal de salida, en donde las puertas lógicas (202, 203) de la ruta de reloj incluyen un dispositivo desplazador de nivel (201) configurado para desplazar el nivel de una señal de reloj desde el primer nivel de suministro de energía al segundo nivel de suministro de energía antes de generar la señal de muestreo, en donde el segundo nivel de suministro de energía (211) es más alto que el primer nivel de suministro de energía (210), y

en donde la ruta de datos incluye una primera puerta de paso (204), una célula maestra acoplada para recibir la señal de entrada procedente de la primera puerta de paso (204) y que tiene inversores de células maestras (205, 206), una célula esclava acoplada a la célula maestra por intermedio de una segunda puerta de paso (207) y que tiene inversores de células esclavas (208, 209), proporcionando la señal de muestreo a las primera y segunda puertas de paso (204, 207) y para habilitar y deshabilitar inversores (205, 206, 208, 209) en las células maestras y esclavas.

Tipo: Patente Internacional (Tratado de Cooperación de Patentes). Resumen de patente/invención. Número de Solicitud: PCT/US2011/064848.

Solicitante: INTEL CORPORATION.

Nacionalidad solicitante: Estados Unidos de América.

Dirección: 2200 MISSION COLLEGE BOULEVARD SANTA CLARA, CA 95052 ESTADOS UNIDOS DE AMERICA.

Inventor/es: TSCHANZ,James W, RAYCHOWDHURY,ARIJIT, KULKARNI,JAYDEEP.

Fecha de Publicación: .

Clasificación Internacional de Patentes:

  • G06F1/04 SECCION G — FISICA.G06 COMPUTO; CALCULO; CONTEO.G06F TRATAMIENTO DE DATOS DIGITALES ELECTRICOS (computadores en los que una parte del cálculo se efectúa hidráulica o neumáticamente G06D, ópticamente G06E; sistemas de computadores basados en modelos de cálculo específicos G06N). › G06F 1/00 Detalles no cubiertos en los grupos G06F 3/00 - G06F 13/00 y G06F 21/00 (arquitecturas de computadores universales con programas grabados G06F 15/76). › Generación o distribución de señales de reloj o de señales derivadas directamente de éstas.
  • G06F1/26 G06F 1/00 […] › Alimentación en energía eléctrica, p. ej. regulación a este efecto (para las memorias G11C).
  • G06F1/32 G06F 1/00 […] › Medios destinados a economizar energía.

PDF original: ES-2649341_T3.pdf

 

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