Procedimiento de control de acceso de sistema de memoria de doble puerto.

Un procedimiento de control de acceso de un sistema de memoria de doble puerto,

comprendiendo el procedimiento:

solicitar, mediante un primer procesador (120), un acceso desde una memoria de doble puerto (110); y

transmitir, mediante la memoria de doble puerto (110), una señal de resultado de acuerdo con la petición de acceso al primer procesador (120),

en el que la señal de resultado comprende una primera señal de resultado para notificar el éxito de acceso, una segunda señal de resultado para notificar un fallo de acceso, y una tercera señal de resultado para notificar una retención de acceso;

caracterizado porque la transmisión de la señal de resultado comprende:

transmitir una señal de admisión de acceso correspondiente a la primera señal de resultado; y

transmitir una señal de ocupado correspondiente a la segunda señal de resultado y la tercera señal de resultado, en el que la señal de ocupado reconoce la señal de ocupado como la tercera señal de resultado hasta que el tiempo de admisión no transcurre basándose en un tiempo de admisión predeterminado y reconoce la señal de ocupado como la segunda señal de resultado después de transcurrido el tiempo de admisión;

en el que el tiempo de admisión comprende un primer tiempo de admisión establecido en la memoria de doble puerto (110) y un segundo tiempo de admisión establecido en el primer procesador (120),

en el que la memoria de doble puerto (110) transmite una señal de ocupado que representa una de la segunda señal de resultado y la tercera señal de resultado basándose en el primer tiempo de admisión; y

en el que el primer procesador (120) reconoce una señal de ocupado transmitida desde la memoria de doble puerto (110) como una de la segunda señal de resultado y la tercera señal de resultado basándose en el segundo tiempo de admisión.

Tipo: Patente Europea. Resumen de patente/invención. Número de Solicitud: E16151357.

Solicitante: LSIS Co., Ltd.

Nacionalidad solicitante: República de Corea.

Dirección: 127, LS-ro Dongan-gu Anyang-si Gyeonggi-Do 14119 REPUBLICA DE COREA.

Inventor/es: KWON,DAE HYUN, LEE,SOO GANG.

Fecha de Publicación: .

Clasificación Internacional de Patentes:

  • G06F13/16 SECCION G — FISICA.G06 COMPUTO; CALCULO; CONTEO.G06F TRATAMIENTO DE DATOS DIGITALES ELECTRICOS (computadores en los que una parte del cálculo se efectúa hidráulica o neumáticamente G06D, ópticamente G06E; sistemas de computadores basados en modelos de cálculo específicos G06N). › G06F 13/00 Interconexión o transferencia de información u otras señales entre memorias, dispositivos de entrada/salida o unidades de tratamiento (circuitos de interfaz para dispositivos de entrada/salida específicos G06F 3/00; sistemas multiprocesadores G06F 15/16). › para el acceso al bus de memoria (G06F 13/28 tiene prioridad).
  • G06F13/42 G06F 13/00 […] › Protocolo de transferencia para bus, p. ej. interbloqueo; Sincronización.

PDF original: ES-2650074_T3.pdf

 

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