Gestión de memoria dinámica mejorada con minimización inteligente del consumo de corriente/potencia.
Un procedimiento para realizar la gestión de memoria dinámica,
que comprende:
obtener (402, 604, 804) un consumo de corriente/potencia en el estado de baja potencia para cada dispositivo de memoria volátil en una pluralidad de dispositivos de memoria volátil;
copiar (406, 608, 810) los datos desde un primer conjunto de dispositivos de memoria volátil a un segundo conjunto de dispositivos de memoria volátil, donde el segundo conjunto de dispositivos de memoria volátil tiene un consumo más bajo de corriente/potencia del estado de baja potencia que el primer conjunto de dispositivos de memoria volátil; y colocar (408, 610, 812) el primer conjunto de dispositivos de memoria volátil en un estado apagado para reducir el consumo de energía.
Tipo: Patente Internacional (Tratado de Cooperación de Patentes). Resumen de patente/invención. Número de Solicitud: PCT/US2014/010546.
Solicitante: QUALCOMM INCORPORATED.
Nacionalidad solicitante: Estados Unidos de América.
Dirección: 5775 MOREHOUSE DRIVE SAN DIEGO, CA 92121-1714 ESTADOS UNIDOS DE AMERICA.
Inventor/es: HOFMANN,RICHARD GERARD, PARK,HEE JUN, LEE,YONG JU.
Fecha de Publicación: .
Clasificación Internacional de Patentes:
- G06F1/32 FISICA. › G06 CALCULO; CONTEO. › G06F PROCESAMIENTO ELECTRICO DE DATOS DIGITALES (sistemas de computadores basados en modelos de cálculo específicos G06N). › G06F 1/00 Detalles no cubiertos en los grupos G06F 3/00 - G06F 13/00 y G06F 21/00 (arquitecturas de computadores con programas almacenados de propósito general G06F 15/76). › Medios destinados a economizar energía.
- G06F12/00 G06F […] › Acceso, direccionamiento o asignación en sistemas o arquitecturas de memoria (entrada digital a partir de, o salida digital hacia soportes de registro, p. ej. hacia unidades de almacenamiento de disco G06F 3/06).
- G06F13/16 G06F […] › G06F 13/00 Interconexión o transferencia de información u otras señales entre memorias, dispositivos de entrada/salida o unidades de procesamiento (circuitos de interfaz para dispositivos de entrada/salida específicos G06F 3/00; sistemas multiprocesadores G06F 15/16). › para el acceso al bus de memoria (G06F 13/28 tiene prioridad).
PDF original: ES-2602287_T3.pdf
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